Diskusia FF bolo o dosiahnutie nízkej chvenie začiatok konverzie signálu, ale nepovedal ste o vašich jitter Priame merania, v ktorom je to čisto teoretická diskusie až do súčasnosti. Ďalší bod je dekódovanie Serializovaná dáta. Vidím dve možnosti s Arria FPGA: - Použitie Serdes v logických buniek, poháňané Dopingový komisár, nie je prijímač PLL. Jednoduchý, priamočiary spôsob. - Použitie Arria špecializované hardvérové Serdes, ktorý je vždy najazdené PLL. Arria možno vykonať s jedným PLL pre 8 ADC, v prípade, že vnútorné hodiny sa používa skôr ako DCO. DPA funkčnosť s konkrétny snímok ADC sa musí kontrolovať, myslím, že môžete pracovať. Pre konektora, môže každý štandardný s diferenciálnym impedanciou okolo 100 ohmov pracovať. Pre krátke vzdialenosti aj štandardné 0,1 "pin header s IDC káblom.